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  2. ;LAST UPDATE: 28.05.2021 savelij
  3.  
  4.                 include ../macros.a80
  5.                 include define.a80
  6.  
  7.                 ORG 0
  8.  
  9. HEADER          DW EHEADER-HEADER
  10.                 DB "NGSF"
  11.                 DW DATA_VERS
  12. ;BLOK0
  13.         IF LDPAGE=1
  14.                 DD BLOK0*0X100+LOADER_PAGE
  15.                 DW BLOK1-BLOK0
  16.                 binclude loader.crc
  17.                 DB "LOADER"
  18.                 DW DATA_P0
  19.         ENDIF
  20. ;BLOK1         
  21.         IF MAINPAGE=1
  22.                 DD BLOK1*0X100+MAINROM_PAGE
  23.                 DW BLOK7-BLOK1
  24.                 binclude neogs.crc
  25.                 DB "MAIN  "
  26.                 DW DATA_P1
  27.         ENDIF
  28. ;BLOK7
  29.         IF FPGAPAGE=1
  30.                 DD BLOK7*0X100+FPGA_PAGE
  31.                 DW BLOKE-BLOK7
  32.                 binclude fpga.crc
  33.                 DB "FPGA  "
  34.                 DW DATA_P7
  35.         ENDIF
  36. EHEADER
  37.  
  38. BLOK0
  39.         IF LDPAGE=1
  40.                 binclude loader_ngs.rom
  41.         ENDIF
  42.  
  43. BLOK1
  44.         IF MAINPAGE=1
  45.                 binclude neogs.rom
  46.         ENDIF
  47. BLOK7
  48.         IF FPGAPAGE=1
  49.                 binclude fpga.bin
  50.         ENDIF
  51. BLOKE
  52.